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拾陆楼知识星球入口 已知某模块的DCG结果显示存在congestion#xff0c;有congestion部分逻辑结构如下图: 问题1: 如何分析该电路有congestion问题的原因#xff1f; 答#xff1a;data selecti… 我正在「拾陆楼」和朋友们讨论有趣的话题你⼀起来吧
拾陆楼知识星球入口 已知某模块的DCG结果显示存在congestion有congestion部分逻辑结构如下图: 问题1: 如何分析该电路有congestion问题的原因 答data selection模块和后面的logic cone组成了更大的logic cone一起优化congestion问题会引起的timing问题。 问题2: 如何优化这种逻辑结构解决这类congestion 答前面的寄存器和data selection做到一个module里。