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一、基于74ls138译码器设计全加器
两个二进制数之间的算术运算无论是加、减、乘、除目前在数学计算机中都是化作若干步加法运算进行的。因此加法器是构成算术运算器的基本单元。在将两个多位二进制数相加时除了最低位以外每一位都应该考虑来自低位的进位即将两个对应位的加数和来自低位的进位3个数相加。这种运算称为全加所用的电路称为全加器。用两片74LS138设计一个全加器。在考虑到74LS138译码器为3 线-8 线译码器共有 54/74S138和 54/74LS138 两种线路结构型式其74LS138工作原理为当一个选通端(G1)为高电平另两个选通端(/(G2A)和/(G2B))为低电平时可将地址端(A、B、C)的二进制编码在一个对应的输出端以低电平译出。根据以上特性设计制作出一个全加器。
74LS138有三个附加的控制端。当输出为高电平(S1)译码器处于工作状态。否则译码器被禁止所有的输出端被封锁在高电平。带控制输入端的译码器又是一个完整的数据分配器。如果把作为“数据”输入端(在同一个时间)而将作为“地址”输入端那么从送来的数据只能通过所指定的一根输出线送出去。这就不难理解为什么把叫做地址输入了。例如当101时门的输入端除了接至输出端的一个以外全是高电平因此的数据以反码的形式从输出而不会被送到其他任何一个输出端上。 用门电路实现两个二进数相加并求出和的组合线路称为一个全加器。 全加器原理图 A/a B/b C/c为全加器和译码器的输入OUT为译码器的输出(0 ~7)S为加法器的和Co为加法器进位输出。PS假定译码器输出高电平有效。 由表74LS138(2)得出将3/8译码器的输出OUT(1247)作为一个四输入或门的输入或门的输出作为加法器的和;将3/8译码器的输出OUT(3567)作为一个四输入的或门的输入或门的输出作为加法器的进位输出。 二、74ls48内部电路,74ls48译码器真值表
用74ls138设计全加器
74LS48芯片是一种常用的七段数码管译码器驱动器常用在各种数字电路和单片机系统的显示系统中下面我就给大家介绍一下这个元件的一些参数与应用技术等资料。 74LS48除了有实现7段显示译码器基本功能的输入(DCBA)和输出(YaYg)端外7448还引入了灯测试输入端(LT)和动态灭零输入端(RBI)以及既有输入功能又有输出功能的消隐输入/动态灭零输出(BI/RBO)端。
7段显示译码器74LS48是输出高电平有效的译码器74LS48除了有实现7段显示译码器基本功能的输入(DCBA)和输出(YaYg)端外7448还引入了灯测试输入端(LT)和动态灭零输入端(RBI)以及既有输入功能又有输出功能的消隐输入/动态灭零输出(BI/RBO)端。
74LS48逻辑图 74LS48方框图 74LS48符号图 上图中给出了74LS48的逻辑图方框图和符号图。由符号图可以知道4号管脚端具有输入和输出双重功能。作为输入(BI)低电平时G21为0所有字段输出置0即实现消隐功能。作为输出(RBO)相当于LT及CT0的与坟系即LT1RBI0DCBA0000时输出低电平可实现动态灭零功能。3号(LT)端有效低电平时V201所有字段置1实现灯测试功能。
74ls48译码器真值表 由7448真值表可获知所具有的逻辑功能
(1)7段译码功能(LT1RBI1)
在灯测试输入端(LT)和动态灭零输入端(RBI)都接无效电平时输入DCBA经7448译码输出高电平有效的7段字符显示器的驱动信号显示相应字符。除DCBA 0000外RBI也可以接低电平见表1中116行。
(2)消隐功能(BI0)
此时BI/RBO端作为输入端该端输入低电平信号时表1倒数第3行无论LT 和RBI输入什么电平信号不管输入DCBA为什么状态输出全为“0”7段显示器熄灭。该功能主要用于多显示器的动态显示。
(3)灯测试功能(LT 0)
此时BI/RBO端作为输出端 端输入低电平信号时表1最后一行与 及DCBA输入无关输出全为“1”显示器7个字段都点亮。该功能用于7段显示器测试判别是否有损坏的字段。
(4)动态灭零功能(LT1RBI1)
此时BI/RBO端也作为输出端LT 端输入高电平信号RBI 端输入低电平信号若此时DCBA 0000表1倒数第2行输出全为“0”显示器熄灭不显示这个零。DCBA≠0则对显示无影响。该功能主要用于多个7段显示器同时显示时熄灭高位的零。
74ls48常用电路图 在MulTIsim10中使用74LS48电路见图模块没有错误。为了省事直接了一个限流电阻20Ω仿真正确工作。如果真实电路应该在每段加300Ω限流电阻。
