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wire线网: 仅支持组合逻辑建模必须由assign语句赋值不能在always块中驱动用于连接子模块的输出用于定义模块的输入端口reg寄存器： 可支持组合逻辑或时序逻辑建模必须在always块中赋值二、实例
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assign cnt … 文章目录 一、wire vs reg二、实例 一、wire vs reg
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仅支持组合逻辑建模必须由assign语句赋值不能在always块中驱动用于连接子模块的输出用于定义模块的输入端口reg寄存器：
可支持组合逻辑或时序逻辑建模必须在always块中赋值二、实例
wire [7:0] cnt;
assign cnt = 8'b1111_1111;//
reg [
