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接着昨天的进行一个小的实验验证ROM IP核。
实验效果
读取上一期生成的IP核中的数据#xff0c;并将其显示在数码管上。
具体流程
ROM IP核存放数据0~255#xff0c;之后每隔0.2s#xff0c;从0的地址开始读数据#xff0c;并显示在数码管上#xff1b;接着先后…前言
接着昨天的进行一个小的实验验证ROM IP核。
实验效果
读取上一期生成的IP核中的数据并将其显示在数码管上。
具体流程
ROM IP核存放数据0~255之后每隔0.2s从0的地址开始读数据并显示在数码管上接着先后使用两个按键信号读取指定地址数据完成后从当前地址开始继续0.2s间隔往后读取数据。
步骤
调用模块
ROM IP核模块 数码管显示模块 按键消抖模块 ROM控制模块 其中按键消抖模块和数码管显示模块为已有模块可直接调用。
ROM IP核模块的调用过程
调用昨天完成的单端口ROM,将文件夹中生成的inst.v文件内容复制到顶层模块后连接各个信号即可
ROM控制模块调用
为什么要添加ROM控制模块ROM的读操作在上升沿触发但实际调用ROM时候并没有读使能需要控制生成读地址。控制框图如下时钟为系统时钟复位信号低电平有效有两个消抖后的按键信号输入信号就是这几个通过它们来产生读取的地址并读取数据。 ROM控制模块控制时序分析如下图所示 系统时钟clk50Mhz一个时钟也就是20ns设计效果是0.2s设计一个计数器实现0.2s变化一次的效果。 计数器cnt_200ms0.2s一个时钟上升沿变化一次最大计数值也就是200_000_000ns/20ns-19_999_999。即CNTMAX9_999_999。计数器每次计数到最大值地址1。按键在某个地址按下时也让计数器为0。 key1与key2按键信号拉高一个时钟。 addr1与addr2读地址的标志信号按下一次后拉高再按下一次后拉低。红色线所示 图中含义是按下按键1后读取地址2的数据按下按键2后读取地址4的数据。可以看到这里延了一拍。绿色线所示。 每次只读取一个地址信号因此每次只能有一个地址标志信号为高电平。 接下来就是参考上面的波形图编写ROM控制模块的代码了 编辑器Notepad
顶层模块设计
顶层模块就是各个子功能模块的实例化和各类信号的连接感觉也是最难得一部分最需要全局思维的一部分。下面是顶层模块输入输出框图其中 clk系统时钟 rst_n复位信号 key[1:0]按键信号 stcp输出数据存储器时钟 shcp移位寄存器时钟输入 ds串行数据输入 oe输出使能信号
编写顶层模块代码
仿真与上板验证
这里就不贴具体代码了结果符合预期上板验证随机连续拍了几张图还不知道怎么传视频
小结
感觉还是有些懵懂还需要多花时间琢磨一下。
